三态门-概念
三态门输出电路除了有高低电平两个状态之外，还有第三个状态--Hi-Z高阻态；
三态门-电路原理
三态门-应用
a.双向传输
在verilog我们使用inout的端口时，常常会使用这样的语句:assing out = en ? out_tmp : 1'bz;其含义是当en=1时，输出接口输出具体电平out_tmp，en=0时则当作输入接口使用，赋值为Hi-Z态，允许外部信号的拉低或者拉高；
电路结构如下图
b.总线结构
电路结构：
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